7 Series FPGAs GTP Transceiver를 사용할 경우에 PCB 진행 시의 주의사항

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7  Series FPGAs GTP Transceiver를 사용할 경우에 PCB 진행 시의 주의사항에 대하여 설명하려고 합니다.

앞으로 설명하는 모든 자료는

UG482 문서의 Page 235를 보면 아래와 같이 GTP Transceiver에 대한 PCB Artwork 진행 시 고려하여야할 부분에 대한 설명이 있습니다.
GTP Transceiver의 Performance를 위하여 반드시 지켜야 할 사항입니다.




1. The following guidelines must be followed when routing GTP Transceiver data signals on the PCB

  1. Eliminate routing of GTP Transceiver signals and SelectIO signals on adjacent layers. Be aware of the potential of broadside coupling if these signals are routed on adjacent layers.

  1. Maintain isolation of the return current paths for both the SelectIO signals and the GTP Transceiver signals including both traces and vias.

  1. The power islands for the GTP Transceivers are also a potential source for SelectIO induced noise. SelectIO signals should not be routed over the GTP power islands.




2. Specific SelectIO Guidelines Pertaining to the FGG676 Package

FFG676 Package만 별도로 아래와 같은 사항을 고려하여야 합니다.

  1. GTP Transceiver를 6 Gb/s 이상 사용할 경우, Bank 16, Bank 35의 UserIO 사용을 피해야 합니다.

  1. 만일 어쩔 수 없이 Bank 16, Bank 35를 사용할 경우, Bank 16, Bank 35의 아래 언급된 User IO Pin들을 사용하지 마세요. 그리고 나머지 User IO Pin들의 사용을 최소화하세요.
    • Bank 16: F17, F18, F20, G15, H14, H15, A17, A18, A19, B17, B19, C17, D16, D18, E16, E18, F15, F19
    • Bank 35: K8, J8, J6, J5, J4, H9, H8, H7, H6, H4, G9, G8, G7, G6, F8, F7, E6, D6




여러분의 FPGA 설계에 도움이 되었길 바랍니다.
그럼, 오늘도 좋은 하루 되세요.


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